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DDR3 & DDR4的设计与仿真

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发表于 2016-4-26 20:00:17 | 显示全部楼层 |阅读模式
DDR3的应用已经深入人心,DDR4也已进入大家的视野,DDR3/DDR4到底有何特性,在设计上该如何满足产品的性能。

本话题本着一博自身的设计经验,在DDR3/DDR4上的技术积累,将从DDRX发展趋势,DDR3/DDR4的新功能,DDR3&4新技术,设计注意事项及仿真测试验证上分享DDR3/DDR4的设计成功经验。


主要内容:
一、
DDR3&4概述
DDRX发展趋势及预期
DDR3&4新功能
DDR3&4新技术-Fly by结构、POD12
……    

二、
DDR3&4拓扑结构
DDR3&4信号拓扑-DQ\DM\DBI\ DQS\ CLK
DQ\ DQS常规布线要求      
DDR3&4信号拓扑-地址/命令信号
……

三、DDR3 &4时序和布线
DDR3时序 Derating、时序参数      
DDR3 &4布线参数     
DDR3 &4布线和容性负载     
DDR3 &4设计与仿真总结
……


四、
DDR3&4关键问题
速率、裕量、
等长、   
串扰、串扰与控制
……   


五、部分案例与仿真验证


附件有课件,大家可以下载哦。

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发表于 2016-6-7 21:54:33 | 显示全部楼层
很不错的学习资料。
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发表于 2016-6-13 10:13:01 | 显示全部楼层
下载学习了,,谢谢!
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发表于 2016-6-16 16:30:11 | 显示全部楼层
感谢楼主的无私分享
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发表于 2016-6-16 16:30:56 | 显示全部楼层
刚看完,再来感谢一次
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发表于 2016-9-20 14:07:30 | 显示全部楼层
很不错的学些资料,多谢楼主分享
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